powerlogic原理图求助？？？

josh915 · 发表于 2006-10-26 15:40:00

在制作原理图模块时，，对于某一模块画引脚时，，都需要设置相应的PIN NAME，，不设置的画就不能保存退出，但我看到有的怎么行，，不知道它怎么弄的，，图在附件中

[此贴子已经被作者于2006-10-26 15:48:28编辑过]

zhouhong83 · 发表于 2006-10-26 19:53:00

是可以的，我以前做过，但具体的还要看看，有答案再传

josh915 · 发表于 2006-10-27 09:47:00

嗯，，等着咯哦

华山刀客 · 发表于 2006-10-27 11:34:00

你是在建库还是在做原理图？

josh915 · 发表于 2006-10-30 15:37:00

画原理图啊

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